1+N+1
Uma camada de microvia por lado para uma transição consciente de custo de multicamada convencional.
HDI A fabricação de PCB suporta o roteamento de escape de pitch fino, geometria de placa compacta e através de microvias a laser, laminação sequencial e, uma estrutura focada na confiabilidade.
A laminação mais sequencial não é automaticamente melhor. A estrutura certa atinge metas de sinal fanout e sem adicionar risco de processo evitável.
Uma camada de microvia por lado para uma transição consciente de custo de multicamada convencional.
Dois ciclos de laminação sequenciais para mais densa BGA escapar e mais liberdade de roteamento.
Processadores avançados, módulos RF e altamente interligados.
Conectividade de microvia entre camadas para projetos que não podem usar um acúmulo fixo.
Os valores abaixo descrevem a capacidade avançada disponível, não uma promessa de que cada limite pode ser combinado em uma placa.

P & D protótipo e high-end HDI constrói
| Contagem de camadas | Até 64 layers para protótipos / construções de engenharia |
|---|---|
| Rastreamento mínimo / espaçamento | 2 / 2 mil (0.05 / 0.05 mm) |
| Broca mecânica padrão | 0.15 mm |
| Capacidade avançada / especial do furo | Até 0.10 mm, sujeito ao processo de design e revisão |
| Microvia mínima do laser | 0.075 mm |
| Relação de aspecto | Até 20: 1 para projetos qualificados; 15: 1 ou abaixo para produção avançada padrão |
| Estruturas HDI | 1+N+1, 2+N+2, HDI e de várias etapas HDI de qualquer camada |
| Através da tecnologia | Vias cegas, vias enterradas, vias empilhadas, vias escalonadas, via-in-pad, VIPPO / POFV, vias revestidas a resina e |
| Laminação sequencial | Apoiado |
| Interligação de qualquer camada | Apoiado |
| Perfuração traseira | Apoiado |
| impedância controlada | Padrão de ±10%; ±5% para exigências mais apertadas |
| Controle de página de guerra | ≤0.5% disponível quando especificado, sujeito a revisão de design empilhamento e |
| Materiais de alta velocidade / alta frequência | Rogers, Taconic/AGC, PTFE/Teflon, F4B, High-Tg FR-4 e outros laminados especiais de baixa perda |
Os valores de capacidade são dependentes do projeto. O material, o peso de cobre, a contagem da camada, através da estrutura, a espessura acabada e superfície do revestimento pode mudar a combinação alcançável.
Vias empilhadas maximizam a densidade, enquanto estruturas escalonadas podem reduzir o estresse. O Via-in-pad suporta fanout BGA de pitch fino, mas requer o preenchimento controlado da planarização e.

Confirme a geometria da microvia, as almofadas de captura, o enchimento, a espessura dielétrica do empilhamento de e antes que o pacote de produção de HDI seja congelado.
Use esses exemplos como ponto de partida. A construção da placa ainda segue os requisitos de qualificação e elétricos e mecânicos do produto.
Dispositivos de consumo com restrição de espaço e.
Denso fanout para pacotes em 0.4 mm pitch e abaixo.
Canais DDR, PCIe e SerDes com transições controladas.
Módulos que requerem roteamento compacto e impedância controlada.
Portable diagnóstico e eletrônica de imagem.
Módulos de sensor ADAS, câmera e com alta densidade de interconexão.
Estas respostas abordam a estrutura comum de HDI, microvia, decisões de manufactura de impedância e.
As construções avançadas de HDI podem usar uma broca a laser 0.075 mm. A almofada de captura, a relação de aspecto de microvia e de espessura dielétrica ainda requer confirmação em nível de empilhamento.
Sim, a interconexão de qualquer camada está disponível para projetos que precisam de conectividade por microvia durante todo o acúmulo. Ele recebe uma revisão de laminação e de engenharia dedicada.
Uma estrutura 1+N+1 é o ponto de entrada usual. A engenharia só deve adicionar camadas sequenciais quando os requisitos de sinal ou de roteamento de escape as justificarem.
Material Dk, espessura dielétrica, geometria de cobre A espessura acabada de e é modelada em conjunto. O controle ±5% está disponível para requisitos mais apertados em construções avançadas qualificadas.
Compare HDI com a construção multicamada convencional, limites de processo publicados, DFM revisão e validação de protótipo.
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